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Verilog编写的RISC-V处理器,支持RV32IM指令集,机器模式,单周期指令,哈佛结构,AXI4-Lite总线。MCU级别的处理器,麻雀虽小,五脏俱全。riscv有无限可能,未来将不断完善,大家的支持是我前进的动力。
Verilog
13天前
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从零写一个16位处理器,采用自主设计的大黄鸭指令集,单周期3级流水线,8位指令双发射。配套大黄鸭汇编器,简化程序开发。目前主体设计已完成,大家的支持是我前进的动力。
Verilog
3个月前
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玉衡是一款从零开始写的 RISC-V 内核的处理器,基于 Verilog 硬件设计语言实现,五级流水线设计,支持 RV32IMFD 指令集,支持中断,支持 RT-Thread Nano 3.1.5
Verilog
3个月前
8650835 deepcomm 1625368542
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使用DDS芯片AD9914产生线性扫频信号
Verilog
1年前
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支持OpenGL ES 1.1的GPU内核
Verilog
2年前
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FPGA&VerilogHDL应用设计教程,包括课程思维导图、各章实例、各实验源码、综合实验例程。
5322946 liangkangnan 1578984522
一个从零开始写的极简、非常易懂的RISC-V处理器核。
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基于zynq的HDMI驱动,开发环境:Miz702开发板(兼容zedboard),vivado 2015.2
Verilog
6年多前
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基于zynq的VGA驱动,开发环境:Miz702开发板(兼容zedboard),vivado 2015.2 1.480*640 分辨率 2.显示静态彩色图片
Verilog
6年多前

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